Bibliografie

(eng): This paper presents a technique that allows to preserve structure of a circuit according to a target technology during fault emulation in FPGA. The technique is not restricted to any target technology or FPGA emulation platform. It is compatible with fault injection techniques based both on circuit instrumentation and partial runtime reconfiguration. An extension of this technique that allows to emulate timing parameters of the circuit through an introduction of a virtual time is also proposed. An area and timing overhead due to preserving the circuit structure and parameters of basic delay elements are evaluated by experiments.

(cze): Tento článek popisuje metodu, která umožňuje zachovat strukturu emulovaného obvodu s ohledem na cílovou technologii při emulaci poruch pomocí FPGA. Metodu lze použít pro libovolnou cílovou technologii a libovolné FPGA. Metoda umožňuje použít pro vkládání poruch jak metody založené na modifikaci obvodu, tak metody založené na částečné dynamické rekonfiguraci. Metoda dále umožňuje emulovat zpoždění v obvodu pomocí virtuálního času. Základní parametry metody byly vyhodnoceny pomocí několika experimentů.